fr.wedoany.com Rapport : La société autrichienne ParityQC et l'Université d'Innsbruck ont officiellement publié le 7 mai 2026 un schéma de calcul quantique tolérant aux pannes nommé « Architecture de distillation par expansion de parité », qui réduit systématiquement les ressources nécessaires au calcul quantique universel en distillant directement des portes non-Clifford de tout niveau sur un matériel à bruit biaisé. Lors de la synthèse de portes de rotation à petit angle arbitraire, cette architecture abaisse la limite inférieure du taux d'erreur logique de 43 % et réduit les besoins en ressources de qubits de 26 % par rapport aux schémas traditionnels de distillation de porte T unique.
L'innovation centrale de cette architecture réside dans l'abandon du cadre traditionnel de l'ensemble de portes « Clifford + T ». Le calcul quantique tolérant aux pannes existant repose sur la décomposition de toute porte de rotation en une longue séquence de portes de Clifford et de portes T — chaque porte T nécessitant une grande quantité de qubits pour la distillation d'états magiques, ce qui constitue le principal goulot d'étranglement limitant la fidélité des portes logiques. L'approche proposée par l'équipe de ParityQC prépare et transmet directement des portes de rotation à petit angle Z1/2^k, sans passer par une approximation via des séquences de portes T, réduisant ainsi à la source la quantité totale de ressources nécessaires à la synthèse des portes.
L'architecture de distillation par expansion de parité est spécifiquement conçue pour s'adapter aux plateformes matérielles à bruit biaisé — plateformes où le taux d'erreur de basculement de phase dépasse largement le taux d'erreur de basculement de bit, s'écartant significativement du modèle de bruit symétrique supposé par les codes correcteurs d'erreurs quantiques standard. La formule de budget de ressources en qubits donnée par l'équipe de recherche est 2k+3+O(2^k/2), un ordre de grandeur de ressources qui rend pour la première fois accessible en ingénierie la distillation au niveau de la porte T1/32 (k=7). Pour les applications telles que la transformée de Fourier quantique et les algorithmes d'estimation de phase nécessitant des portes Z1/2^k natives, ce schéma permet une préparation tolérante aux pannes dans la limite de k=7, sans décomposition supplémentaire.
Une autre contrainte clé est la compatibilité avec les agencements planaires bidimensionnels. Les portes non-Clifford traditionnelles sont soumises à une limitation de théorème d'illimitation sur les puces planaires ne supportant que les interconnexions entre voisins proches — la réalisation tolérante aux pannes de portes non-Clifford de haut niveau nécessite généralement une connectivité de qubits en haute dimension. L'architecture de distillation par expansion de parité, en introduisant un processus d'expansion de vérification de parité, permet la distillation tolérante aux pannes de portes de rotation de tout niveau dans la hiérarchie de Clifford, tout en maintenant toutes les contraintes d'interconnexion de voisinage de la puce planaire. Cela signifie que ce schéma peut être directement déployé sur les processeurs quantiques bidimensionnels grand public actuels tels que les supraconducteurs, les ions piégés et les atomes neutres.
ParityQC, dont le siège est à Innsbruck en Autriche, a été cofondée par Wolfgang Lechner, professeur de physique théorique à l'Université d'Innsbruck, et Magdalena Hauser. C'est la première entreprise indépendante au monde à se consacrer exclusivement à l'architecture quantique. Avec pour produits principaux l'Architecture ParityQC et le système d'exploitation ParityOS, elle fournit des plans évolutifs et des jeux d'instructions pour le matériel quantique, ses partenaires de collaboration couvrant des fabricants de matériel de diverses filières telles que les supraconducteurs et les ions piégés.
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